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Mémoire d'accès aléatoire dynamique DRAM 8 Go x16 x2 canal mobile LPDDR4 / LPDDR4X IS43LQ32256B-062BLI

• Configuration: 256 Mo x16 x 2 canaux - 8 banques internes par canal
• Alimentation à faible tension et à l'E / S:
  • VDD1 = 1,70-1,95 V
  • Vdd2 = 1,06-1.17v
  • VDDQ = 1,06-1.17V (LPDDR4)
  • VDDQ = 0,57-0,65 V (LPDDR4X)
• LVSTL (interface d'E / S à basse tension)
• Formation interne VREF et VREF
• Dynamic ODT: DQ ODT: terminaison VSSQ, CA ODT: terminaison VSS
• Max. Fréquence d'horloge: 1866 MHz (3733 Mbps)
• 16N Architecture DDR pré-fetch
• Bus de commande de données (cycles multiples)
• Données bidirectionnelles / différentielles Strobe par octet de données (DQS / DQS #)
• Longueurs d'éclatement programmables et à la volée (BL = 16, 32)
• Étalonnage ZQ
• GAMMES DE TEMPERSAGE DE FONCTIONS:
  • Industriel (TC = -40 ° C à 95 ° C)
  • Automobile, A1 (TC = -40 ° C à 95 ° C)
  • Automobile, A2 (TC = -40 ° C à 105 ° C)
  • Automobile, A3 (TC = -40 ° C à 125 ° C)
• Capacité d'horloge
• Capteur de température sur puce dont l'état peut être lu à partir de MR4
• Package BGA à 200 balles (10x14,5 mm)

Les IS43 / 46LQ32256B et IS43 / 46LQ32256BL sont 8gbit CMOS LPDDR4 SDRAM. L'appareil est organisé en 2 canaux par appareil, et chaque canal est 8 bandes et 16 bits. Ce produit utilise une architecture à taux de données double pour obtenir un fonctionnement à grande vitesse. L'architecture du débit de données est essentiellement une architecture pré-écaille 16N avec une interface conçue pour transférer deux mots de données par cycle d'horloge aux broches d'E / S.

Ce produit propose des opérations entièrement synchrones référencées à la fois aux bords montant et en chute de l'horloge. Les chemins de données sont pipenés en interne et 16N bits prélectés pour atteindre une bande passante très élevée.

Selon l'emballage d'exportation standard. Les clients peuvent choisir parmi les cartons, les étuis en bois et les palettes en bois en fonction de leurs propres exigences.