Description générale
La famille de Zynq® UltraScale+™ MPSoC est basée sur l'architecture de Xilinx® UltraScale™ MPSoC. Cette famille des produits intègre un quadruple-noyau 64-bit riche en caractéristique ou double-noyau Arm® Cortex®-A53 et système de traitement basé par Cortex-R5F de bras de double-noyau (picoseconde) et architecture programmable d'UltraScale de logique de Xilinx (PL) dans un à un dispositif. Également inclus sont de la mémoire de sur-puce, des interfaces externes de mémoire de multiport, et un riche collection d'interfaces périphériques de connectivité.
Système de traitement (picoseconde)
Le bras Cortex-A53 a basé l'unité de traitement d'application (APU)
- Quadruple-noyau ou double-noyau
- Fréquence d'unité centrale de traitement : Jusqu'à 1.5GHz
- Cohérence extensible de cachette
- Architecture d'Armv8-A
modes opérationnels 64-bit ou à 32 bits d'o
sécurité d'o TrustZone
jeu d'instructions d'o A64 en mode 64-bit, jeu d'instructions A32/T32 en mode à 32 bits
- Minuterie et interruptions
appui générique de minuteries de bras d'o
compteurs au niveau système de triple-minuterie d'o deux
horloge de surveillance d'o un
minuterie de système global d'o un
Attributs de produit
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Statut de produit
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Architecture
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Processeur de noyau
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Quadruple ARM® Cortex®-A53 MPCore™ avec CoreSight™, double ARM®Cortex™-R5 avec CoreSight™, BRAS Mali™-400 MP2
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Taille instantanée
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RAM Size
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Périphériques
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Connectivité
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CANbus, EBI/EMI, Ethernet, ² C, MMC/SD/SDIO, SPI, UART/USART, USB OTG d'I
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Vitesse
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Attributs primaires
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Zynq®UltraScale+™ FPGA, cellules de la logique 256K+
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Température de fonctionnement
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Paquet/cas
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Paquet de dispositif de fournisseur
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Nombre d'entrée-sortie
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Nombre bas de produit
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XCZU5
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Classifications environnementales et d'exportation
| ATTRIBUT |
DESCRIPTION |
| Statut de RoHS |
ROHS3 conforme |
| Niveau de sensibilité d'humidité (MSL) |
4 (72 heures) |
| Statut de PORTÉE |
ATTEIGNEZ inchangé |
| ECCN |
5A002A4 XIL |
| HTSUS |
8542.39.0001 |
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