Conditions de paiement :T/T, Western Union, Paypal, assurance commerciale, carte de crédit
Capacité d'approvisionnement :36pcs
Délai de livraison :3-5 jour
Détails de empaquetage :Emballage de norme internationale
Catégorie :IC FPGA
Condition :Original 100%, tout neuf et original, nouveau
Série :Stratix III augmenté
Nombre de blocs de rangée de logique - laboratoires :10200
Nombre d'I/Os :Entrée-sortie 488
Paquet/cas :FBGA-780
Tension d'alimentation d'opération :1,2 V à 3,3 V
Bloc inclus RAM - EBR :kbit 1594
Service :BOM Kitting
Délai d'exécution :En stock, contact nous
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Réseau prédiffusé programmable de champ d'EP3SE260H780C2N Stratix III augmenté
Attribut de produit
Valeur d'attribut
Intel
FPGA - Réseau prédiffusé programmable de champ
Stratix III augmenté
255000
10200
Entrée-sortie 488
1,2 V à 3,3 V
0 C
+ 70 C
SMD/SMT
BGA-780
Plateau
Série :
Stratix III
Marque :
Intel/Altera
Bloc inclus RAM - EBR :
kbit 1594
Humidité sensible :
Oui
Type de produit :
FPGA - Réseau prédiffusé programmable de champ
Quantité de paquet d'usine :
24
Sous-catégorie :
Logique programmable IC
Mémoire totale :
kbit 16282
Nom commercial :
Stratix
Partie # noms d'emprunt :
971108
Les dispositifs de Stratix III offrent les caractéristiques suivantes :
■Circuits intégrés du codage de correction d'erreurs (CCE) pour détecter et corriger des erreurs de données dans des blocs de mémoire de M144K TriMatrix ■Appui de processeur inclus par II de Nios® ■Soutien des megafunctions multiples de propriété intellectuelle des fonctions d'Altera® MegaCore® et du programme d'associés d'Altera Megafunction (AMPPSM) ■Soutien des normes de canal ultra-rapides de mise en réseau et de communications comprenant SPI-4.2, SFI-4, SGMII, Utopie IV, 10 Gigabit Ethernet XSBI, entrée-sortie rapide, et NPSI ■La seule haute densité, le FPGA performant avec le soutien 256 du bit AES volatil et la clé non-volatile de sécurité pour protéger des conceptions ■Socketing de sur-puce robuste et appui chauds d'ordonnancement de puissance ■Contrôle par redondance cyclique intégré (centre de détection et de contrôle) pour la détection des erreurs de mémoire de configuration dans la détermination des erreurs critiques pour l'appui de systèmes facilement disponible ■Jusqu'à 16 horloges globales, 88 horloges régionales, et 116 horloges périphériques par dispositif ■Jusqu'à 12 boucles à verrouillage déphasé (PLLs) par dispositif qui soutiennent la reconfiguration de PLL, le changement d'horloge, la largeur de bande programmable, la synthèse d'horloge, et déphaseur dynamique ■Appui d'interface de mémoire avec la logique consacrée de DQS sur toutes les banques d'entrée-sortie ■Soutien des interfaces externes ultra-rapides de mémoire comprenant la RDA, le DDR2, le DDR3 SDRAM, le RLDRAM II, le QDR II, et le QDR II+ SRAM sur jusqu'à 24 banques modulaires d'entrée-sortie
