CHUANGXINDA ELECTRONICS-TECH CO., LIMITED

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Entrée-sortie Stratix V GX de 5SGXMABN2F45I2LN 850mV 840

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CHUANGXINDA ELECTRONICS-TECH CO., LIMITED
Ville:shenzhen
Province / État:guangdong
Pays / Région:china
Contact:CXDA-FPGA
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Entrée-sortie Stratix V GX de 5SGXMABN2F45I2LN 850mV 840

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Number modèle :5SGXMABN2F45I2LN
Quantité d'ordre minimum :1 PCS
Conditions de paiement :T/T, Western Union, Paypal, assurance commerciale, carte de crédit
Capacité d'approvisionnement :108 PCs
Délai de livraison :3-5 jour
Détails de empaquetage :Emballage de norme internationale
Catégorie :IC FPGA
Condition :Original 100%, tout neuf et original, nouveau
Série :Stratix V GX
Nombre de blocs de rangée de logique - laboratoires :359200
Nombre d'I/Os :Entrée-sortie 840
Tension d'alimentation d'opération :850 système mv
Paquet/cas :FBGA-1932
Débit :14,1 Gb/s
Service :BOM Kitting
Délai d'exécution :En stock, contact nous
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Entrée-sortie Stratix V GX de la puce FBGA-1932 840 de 5SGXMABN2F45I2LN ALTERA FPGA
 

Attribut de produit Valeur d'attribut
Intel
FPGA - Réseau prédiffusé programmable de champ
Stratix V GX
952000
359200
Entrée-sortie 840
850 système mv
- 40 C
+ 85 C
SMD/SMT
FBGA-1932
Plateau
Débit : 14,1 Gb/s
Série : Stratix V GX 5SGXAB
Marque : Intel/Altera
Humidité sensible : Oui
Nombre d'émetteurs-récepteurs : Émetteur-récepteur 48
Type de produit : FPGA - Réseau prédiffusé programmable de champ
Quantité de paquet d'usine : 12
Sous-catégorie : Logique programmable IC
Mémoire totale : 62,96 Mbit
Nom commercial : Stratix V FPGA
Partie # noms d'emprunt : 966585

 

Stratix V comporte le résumé• technologie transformatrice de 28 nanomètre TSMC
• ALM augmenté avec quatre registres
• Amélioré l'acheminement de l'architecture réduit la congestion et s'améliore pour compiler des périodes
• M20K : 20-Kbit avec le code de correction d'erreurs dur (CCE)
• MLAB : bit 640
• Représentation de jusqu'à 600 mégahertz
• Nouveaux 27x27 indigènes multiplient le mode
• accumulateur et cascade 64-bit pour des réponses d'impulsion finies systoliques (sapins)
• Mémoire interne incluse de coefficient
• le Pré-additionneur/subtractor améliore l'efficacité
• 1.6-Gbps LVDS
• interface externe de la mémoire 1,066-MHz
• arrêt de Sur-puce (OCT.)
• 1.2-V à 3.3-V connectant pour tous les dispositifs de Stratix V
• Protocol stack Gen3, Gen2, et Gen1 de PCIe, point final x1/x2/x4/x8 et port complets de racine
• Couche inférieure de codage physique d'Interlaken (PCS)
• Gigabit Ethernet (GbE) et XAUI PCS
• 10G Ethernet PCS
• RapidIO® périodique (SRIO) PCS
• Interface par radio publique commune (CPRI) PCS
• Mise en réseau optique passive de gigabit (GPON) PCS



 

 Entrée-sortie Stratix V GX de 5SGXMABN2F45I2LN 850mV 840

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