Trellis programmable du réseau prédiffusé de champ de LFE3-17EA-6FTN256I ECP3
Caractéristiques
une densité plus élevée de logique de pour le système accru
Intégration
• 17K à 149K LUTs
• 116 à 586 I/Os
SERDES incorporé par
• 150 Mbps à 3,2 GBP pour 8b10b générique, bit 10
SERDES, et modes à 8 bits de SERDES
• Débits 230 Mbps à 3,2 GBP par canal
pour tous autres protocoles
• Jusqu'à 16 canaux par dispositif : PCI Express,
SONET/SDH, Ethernet (1GbE, SGMII, XAUI),
CPRI, SMPTE 3G et RapidIO périodique
sysDSP™ de
• Architecture de tranche entièrement cascadable
• 12 à 160 tranches pour la haute performance se multiplient
et accumulez
• 54 opérations puissantes du bit ALU
• Répartition temporelle multiplexant partager de MAC
• Arrondissage et troncation
• Appuis de chaque tranche
— Demi 36x36, deux 18x18 ou quatre multiplicateurs 9x9
— MAC 18x36 avancé et 18x18 multiplient-
Multiplier-accumulez les opérations de (MMAC)
ressources de mémoire flexibles de
• Jusqu'au sysMEM™ 6.85Mbits bloc inclus
RAM (EBR)
• 36K au peu 303K a distribué RAM
sysCLOCK PLLs et DLLs analogues de
• Deux DLLs et jusqu'à dix PLLs par dispositif
entrée-sortie synchrone de source Pré-machinée par
• Registres de la RDA en cellules d'entrée-sortie
• Fonctionnalité de mise à niveau lecture/écriture consacrée
• Logique consacrée d'embrayage
• Appui synchrone de normes de source
— ADC/DAC, 7:1 LVDS, XGMII
Dispositifs à hauteur de la vitesse ADC/DAC
• Mémoire DDR/DDR2/DDR3 consacrée avec DQS
appui
• facultatif de (ISI) de brouillage intersymbole
correction sur des sorties
appuis programmables de tampon du sysI/O™
Éventail d'interfaces
• arrêt de Sur-puce
• Filtre facultatif d'égalisation sur des entrées
• LVTTL et LVCMOS 33/25/18/15/12
• SSTL 33/25/18/15 I, II
• HSTL15 I et HSTL18 I, II
• PCI et différentiel HSTL, SSTL
• LVDS, autobus-LVDS, LVPECL, RSDS, MLVDS
configuration de dispositif flexible de
• Banque consacrée pour la configuration I/Os
• Interface d'instantané de botte de SPI
• images de Double-botte soutenues
• SPI slave
• Entrée-sortie de TransFR™ pour les mises à jour simples de champ
• Macro inclus Detect mineur d'erreur
appui au niveau système de
• IEEE 1149,1 et IEEE 1532 conforme
• Indiquez l'analyseur de logique
• Utilité de configuration d'ORCAstra FPGA
• oscillateur de Sur-puce pour l'initialisation et l'usage général
• 1,2 alimentation d'énergie de noyau de V
Tableau 1-1. Guide de sélection de famille de LatticeECP3™
Dispositif ECP3-17 ECP3-35 ECP3-70 ECP3-95 ECP3-150
LUTs (k) 17 33 67 92 149
le sysMEM bloque (18 Kbits) 38 72 240 240 372
Mémoire incluse (Kbits) 700 1327 4420 4420 6850
Peu distribué de RAM (Kbits) 36 68 145 188 303
18 x 18 multiplicateurs 24 64 128 128 320
SERDES (quadruple) 1 1 3 3 4
PLLs/DLLs 2/2 4/2 10/2 10/2 10/2
Paquets et combinaisons d'entrée-sortie de canaux de SERDES
csBGA 328 (10 x 10 millimètres) 2/116
ftBGA 256 (17 x 17 millimètres) 4/133 4/133
fpBGA 484 (23 x 23 millimètres) 4/222 4/295 4/295 4/295
fpBGA 672 (27 x 27 millimètres) 4/310 8/380 8/380 8/380
fpBGA 1156 (35 x 35 millimètres) 12/490 12/490 16/586
Q1. Quels sont vos termes de l'emballage ?
A : Généralement, nous emballons nos marchandises dans des boîtiers blancs neutres et des cartons bruns. Si vous avez légalement enregistré le brevet, nous pouvons emballer les marchandises dans des vos boîtes marquées après avoir reçu vos lettres d'autorisation.
Q2. Quel est votre MOQ ?
A : Nous te fournissons petit MOQ pour chaque article, il dépend votre ordre spécifique !
Q3. Est-ce que vous examinez ou vérifiez toutes vos marchandises avant la livraison ?
A : Oui, nous avons l'essai de 100% et vérifions toutes les marchandises avant la livraison.
Q4 : Comment rendez-vous nos affaires des relations à long terme et bonnes ?
A : Nous gardons la bonne qualité et le prix concurrentiel pour assurer nos clients bénéficient ;
Nous respectons chaque client pendant que notre ami et nous font sincèrement des affaires et font des amis avec eux, il n'est pas quelque chose qui peuvent être remplacés.
Q5 : Comment nous contacter ?
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