Fiche technique périodique de famille du ⑩ EEPROM de la puce I2C du circuit intégré 24LC256-I/SM

Numéro de type:24LC256-I/SM
Point d'origine:Usine originale
Quantité d'ordre minimum:10pcs
Conditions de paiement:T / T, Western Union, Paypal
Capacité d'approvisionnement:4800pcs
Délai de livraison:jour 1
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Shenzhen Guangdong China
Adresse: Secteur de construction de B-9P/10N Duhui 100 Futian, Shenzhen, Chine
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Ifiche technique 2deC™EEPROMpériodiquedefamille

 

 

Caractéristiques :

• bit 128 512 dispositifs de Kbit

• Choisissez l'approvisionnement avec l'opération vers le bas 1.7V pour les dispositifs 24AAXX

• Technologie de basse puissance de CMOS :

  - courant actif de 1 mA, typique

  - 1 courant de réserve de μA, typique (Je-temp)

 

• autobus 2 fils d'interface série, I2C™ compatible

• Entrées de déclencheur de Schmitt pour la suppression de bruit

• Contrôle de pente de sortie pour éliminer le rebond au sol

• 100 kilohertz (1.7V) et 400 kilohertz (≥ 2.5V) de compatibilité

• 1 mégahertz pour les produits 24FCXX

• Auto-synchronisé écrivez le cycle (automatique-effacement y compris)

• La page écrivent le tampon

 

• Protection contre l'écriture de matériel disponible sur la plupart des dispositifs

• Programmation d'usine (QTP) disponible

• Protection d'ESD > 4,000V

• 1 million d'effacement/écrivent des cycles

• Conservation de données > 200 ans

• 8 avance paquets de PDIP, de SOIC, de TSSOP et de MSOP

• 5 paquet de l'avance SOT-23 (les la plupart 1-16 dispositifs de Kbit)

• avance 8 paquets de 2x3mm et de 5x6mm DFN disponibles

 

• sans Pb et RoHS conformes

• Disponible pour les températures ambiantes prolongées :

  - (i) industriel : -40°C +85°C

  - (e) des véhicules moteur : -40°C +125°C

 

 

Description :

Microchip Technology les dispositifs 24CXX, 24LCXX, 24AAXX et 24FCXX (24XX*) d'Inc. sont une famille du bit 128 512 bals d'étudiants électriquement effacés de Kbit. Les dispositifs sont organisés dans les blocs de mémoire de x8-bit avec les interfaces série 2 fils. La conception de basse tension permet l'opération vers le bas 1.7V (pour dispositifs 24AAXX), avec les courants de réserve et actifs de seulement 1 μA et de 1 mA, respectivement. Les dispositifs 1 Kbit et plus grand font écrire la page la capacité.

Les pièces ayant les lignes fonctionnelles d'adresse permettent la connexion de jusqu' 8 dispositifs sur le même autobus. La famille 24XX est disponible en goupille PDIP de la norme 8, bti SOIC de surface, paquets de TSSOP et de MSOP. Les la plupart le bit 128 16 dispositifs de Kbit sont également disponibles dans 5 le paquet de l'avance SOT-23. Les paquets de DFN (2x3mm ou 5x6mm) sont également disponibles. Tous les paquets sont finition sans Pb (de bidon mat).

 

*24XX est employé dans ce document comme numéro de la pièce générique pour 24 dispositifs de série en cette fiche technique. 24XX64, par exemple, représente toutes les tensions du dispositif de 64 Kbit.

 

 

Capacités absolues (†)

V ....................................................................................................................................... 6.5V deCC

Toutes les entrées et sorties w.r.t. V solides solubles ................................................................... -0.6V V cc +1,0 V

Température de stockage .......................................................................................... - 65°C +150°C

La température ambiante avec la puissance s'est appliquée ............................................................. - 40°C +125°C

Protection d'ESD sur tout le ≥ de goupilles ................................................................................................... 4 kilovolts

                                                                                                                                                               

AVIS de † : Les efforts au-dessus de ceux énumérés sous « des capacités absolues » peuvent endommager permanent le dispositif. C'est un effort évaluant seulement et l'opération fonctionnelle du dispositif ceux ou d'aucune autre condition au-dessus de ceux indiqués dans les listes opérationnelles de ces spécifications n'est pas impliquée. L'exposition aux conditions maximum d'estimation pendant des périodes prolongées peut affecter la fiabilité de dispositif.

 

DESCRIPTION FONCTIONNELLE

Chaque dispositif 24XX soutient un autobus et un protocole bidirectionnels et 2 fils de transmission de données. Un dispositif qui envoie des données sur l'autobus est défini comme émetteur, alors qu'un dispositif recevant des données est défini comme récepteur. L'autobus doit être commandé par un dispositif principal qui produit de l'horloge périodique (SCL), commande l'accès d'autobus et produit des conditions de début et d'arrêt, alors que le 24XX fonctionne en tant qu'esclave. Maîtrisez et asservissez peut fonctionner comme émetteur ou récepteur, mais le dispositif principal détermine quel mode est activé.

 

Schéma fonctionnel

 

Le paquet dactylographie (1)

 

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Fiche technique périodique de famille du ⑩ EEPROM de la puce I2C du circuit intégré 24LC256-I/SM

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