PROM programmables de configuration de circuit intégré de XC4VSX55-10FFG1148I de plate-forme de Dans-système électronique d'instantané

Aperçu de la famille Virtex-4

Description générale

La famille de Virtex-4™ est la plus nouvelle génération FPGA de Xilinx. Le bloc modulaire de silicium avancé innovateur ou l'architecture basée sur colonne d'ASMBL™ est unique dans l'industrie programmable de logique. Virtex-4 FPGAs contiennent trois familles (plates-formes) : LX, FX, et SX. Des combinaisons de choix et de caractéristique sont offertes pour toutes les applications complexes. Une grande sélection du noyau dur-IP bloque complet la solution de système. Ces noyaux des blocs incluent les processeurs de PowerPC™ (avec une nouvelle interface d'APU), des impers d'Ethernet de Tri mode, 622 Mb/s 11,1 émetteurs-récepteurs périodiques de Gb/s, de tension/température moniteur système, des tranches consacrées de DSP, des circuits ultra-rapides de gestion d'horloge, et des blocs source-synchrones d'interface. Les blocs Virtex-4 constitutifs de base sont une amélioration de ceux trouvés dans les familles de produits basées sur Virtex populaires : Virtex, Virtex-E, Virtex-II, Virtex-II pro, et Virtex-II pro X, permettant la compatibilité ascendante des conceptions existantes. Les dispositifs Virtex-4 sont produits sur un processus d'en cuivre de la situation actuelle 90 nanomètre, utilisant 300 millimètres (12 pouces) de technologie de gaufrette. Combinant une grande variété de caractéristiques flexibles, la famille Virtex-4 renforce le potentiel programmable de conception de logique et est une alternative puissante la technologie d'ASIC.

Technologie de SelectIO

• Jusqu' 960 utilisateur I/Os

• Larges choix des normes d'entrée-sortie de 1.5V 3.3V

• Extrêmement performant

- 600 Mb/s HSTL et SSTL (sur toute l'entrée-sortie assymétrique)

- 1 Gb/s LVDS (sur toutes les paires d'entrée-sortie de différentiel)

• Véritable arrêt différentiel

• Bas-capacité choisie I/Os pour l'intégrité du signal améliorée

• La même capture de bord l'entrée et sortie I/Os

• Soutien d'interface de mémoire de la RDA et le DDR-2 SDRAM, le QDR-II, le RLDRAM-II, et le FCRAM-II

Technologie de ChipSync

• Intégré avec la technologie de SelectIO pour simplifier les interfaces source-synchrones

• capacité de deskew de Par-peu établie dans tous les blocs d'entrée-sortie (ligne retard variable d'entrée)

• Entrée-sortie consacrée et ressources de synchronisation régionales (goupille et arbres)

• Construit dans la logique de serializer/deserializer de données en tous les diviseurs d'entrée-sortie et d'horloge

• La mémoire/mise en réseau/télécommunication connecte jusqu' 1 Gb/s+

BULLETIN DE LA COTE 

Anterwell était construction en 2004, ce moment-l nous juste une petite entreprise comme une graine.

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