Transistor de puissance de transistor MOSFET de TMS320DM368ZCE TMS320DM368ZCEDF DSP, DSC Digital Media SOC

Number modèle:TMS320DM368ZCE
Fréquence du signal d'horloge maximum:432 mégahertz
Mémoire d'instruction de la cachette L1:16 KBS
Mémoire de données de la cachette L1:kB 8
Données RAM Size:kB 32
Tension d'alimentation d'opération:1,35V
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Adresse: Pièce 1204, bâtiment international de Dingcheng, ZhenHua Road, secteur de Futian, Shenzhen, Chine.
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Transistor de puissance de transistor MOSFET de TMS320DM368ZCE TMS320DM368ZCEDF DSP, DSC Digital Media SOC

Caractéristiques 1

  • Points culminants
  • – Digital Media performant
    Système-sur-puce (DMSoC)

  • – fréquence de base de 432-MHz ARM926EJ-S

  • – Deux coprocesseurs d'image vidéo
    (HDVICP, MJCP) moteurs

  • – Soutient une gamme de codent, décodent, et
    Opérations visuelles de qualité

  • – Sous-système de traitement visuel

    • Le visage de HW détectent le moteur

    • Remettez la côte le moteur de 1/16x 8x

    • parallèle de 16 bits AFE (analogue d'entrée)
      Interface jusqu' 120 mégahertz

    • 4:2 : 2 interface (8-/16-bit)

    • 8-/16-bit YCC et jusqu' 24-Bit RGB888
      Sortie numérique

    • 3 DACs pour la sortie vidéo analogue de HD

    • Affichage l'écran de matériel (OSD)

  • – Capable du traitement de vidéo de 1080p 30fps H.264

  • – Les périphériques incluent EMAC, USB 2,0 OTG, DDR2/NAND, 5 SPIs, 2 UARTs, 2 MMC/SD/SDIO, balayage principal

  • – 8 modes différents de botte et modes configurables de Puissance-économie

  • – Pin--goupille et compatible au plan logiciel avec DM365

  • – La température prolongée (- 40oC – 85oC) disponible

  • – 3.3-V et 1.8-V entrée-sortie, noyau 1.35-V

  • – rangée de grille de la boule 338-Pin au processus 65nm
    Technologie

• Digital Media performant

dispositif
• Noyau d'ARM926EJ-STM
– Soutien des jeux d'instructions 32 bits et de 16 bits (de mode de Thumb®)
– Prolongements d'instruction de DSP et MAC simple de cycle
– Technologie d'ARM® Jazelle®
– Logique incluse d'ICE-RT pour le temps réel
Corrigez
• Architecture de la mémoire ARM9
– cachette de 16k-octets d'instruction – cachette des données 8K-Byte
– RAM de 32k-octets
– ROM de 16k-octets
– Peu d'Endian
• Deux coprocesseurs d'image vidéo
(HDVICP, MJCP) moteurs
– Appui qu'une gamme de codent et décodent
Opérations
– H.264, MPEG4, MPEG2, MJPEG, JPEG,
WMV9/VC1
• Sous-système de traitement visuel
– Front End Provides :

  • Le visage de HW détectent le moteur

  • Matériel IPIPE pour l'image en temps réel
    Traitement

– Remettez la côte le moteur

  • – Remettez la côte les images de 1/16x 8x

  • – Horizontal distinct/verticale
    Contrôle

  • – Deux chemins simultanés de sortie

  • Interface d'IPIPE (IPIPEIF)

  • Interface de capteur d'image (ISIF) et CMOS
    Interface d'encre en poudre

  • parallèle de 16 bits AFE (Front End analogue)
    Interface jusqu' 120 mégahertz

  • Interface de Glueless la vidéo commune
    Décodeurs

  • BT.601/BT.656/BT.1120 Digital YCbCr
    4:2 : 2 interface (8-/16-Bit)

  • Module d'histogramme

Système-sur-puce (DMSoC)

  • – fréquence de base de 432-MHz ARM926EJ-S

  • – 4:2 : 2 interface (8-/16-Bit)

  • – Capable de la vidéo de 1080p 30fps H.264
    traitement

  • – Pin compatible avec les processeurs DM365

  • – Entièrement compatible au plan logiciel avec ARM9TM

  • – La température prolongée disponible pour 432-MHz

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Transistor de puissance de transistor MOSFET de TMS320DM368ZCE TMS320DM368ZCEDF DSP, DSC Digital Media SOC

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