Circuit intégré logique programmable 48PLLs FPGA 0.95V GW2A-LV18MG196C8/I7
Numéro de modèle:GW2A-LV18MG196C8/I7
Lieu d'origine:N.N.
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Shenzhen China
Adresse:
Salle E, 22e étage, bloc B, bâtiment Duhui 100, sous-district Huaqiangbei, district de Futian, ville de Shenzhen
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Détails du produit
Profil de la société
Détails du produit
FPGA - Matrice de portes programmables par le terrain (FPGA) - Puce
logique programmable GW2A-LV18MG196C8/I7
Spécifications clés
| Attribut | Valeur |
|---|---|
| (LUT4) | 20,736 |
| (FF) | 15,552 |
| SSRAM (bits) | 40K |
| BSRAM | 828K |
| (Multiplicateur 18x18) | 46 |
| (PLL) | 48 |
| Banque d'E/S | 8 |
| GPIO | 384 |
Aperçu du produit
Les produits FPGA de la série GW2A/GW2AR offrent des solutions logiques programmables avec des fonctionnalités complètes, notamment :
- Architecture logique programmable haute densité
- Options de configuration flexibles
- Gestion d'horloge avancée avec PLL
- Prise en charge de plusieurs banques d'E/S
Gestion de l'alimentation
Les produits FPGA de la série GW2A/GW2AR nécessitent plusieurs types de tension :
- Tension du cur (VCC)
- Tension PLL (VCCPLL)
- Tension auxiliaire (VCCX)
- Tension de la banque (VCCIO)
Important : VCCX est une alimentation auxiliaire requise pour le bon
fonctionnement des circuits d'E/S, OSC et BSRAM. Si VCCX est
manquant, la puce ne fonctionnera pas correctement.
Conditions de fonctionnement recommandées
| Nom | Description | Min | Max |
|---|---|---|---|
| VCC | Tension d'alimentation | 0,95 V | 1,05 V |
| VCCPLL | Alimentation PLL | 0,95 V | 1,05 V |
| VCCO | Alimentation de la banque d'E/S | 1,14 V | 3,465 V |
| VCCX | Alimentation auxiliaire | 3,135 V | 3,465 V |
Options de configuration
Le FPGA prend en charge plusieurs méthodes de configuration :
Téléchargement JTAG
Utilisé pour télécharger des données de flux binaire vers la SRAM FPGA, la mémoire flash sur puce ou la mémoire flash externe.
Téléchargement MSPI
En tant que dispositif maître, le mode de configuration MSPI lit automatiquement les données de configuration partir de la mémoire flash externe et les envoie la SRAM FPGA.
Gestion de l'horloge
L'appareil dispose de capacités complètes de gestion de l'horloge :
- Broches d'horloge globales GCLK distribuées en quatre quadrants
- Huit réseaux GCLK par quadrant
- Prise en charge PLL pour le réglage de la fréquence, de la phase et du rapport cyclique
Signalisation différentielle
L'appareil prend en charge les fonctionnalités LVDS (Low Voltage Differential Signaling) :
- Toutes les banques prennent en charge la sortie True LVDS
- BANK0/1 prend en charge une résistance d'entrée différentielle de 100 Ω
- Nécessite une résistance de terminaison de 100 Ω pour l'entrée différentielle
Signaux d'état de configuration
- RECONFIG_N : Fonction de réinitialisation pour la programmation FPGA
- READY : Indique que le FPGA est prêt pour la configuration
- DONE : Signale la configuration FPGA réussie
Images du produit
Emballage et expédition
Emballage d'exportation standard disponible. Les clients peuvent choisir parmi :
- Boîtes en carton
- Caisses en bois
- Palettes en bois
Foire aux questions
Comment obtenir des informations sur les prix ?
Nous fournissons généralement des devis dans les 24 heures suivant la réception de votre demande (hors week-ends et jours fériés). Pour les demandes de prix urgentes, veuillez nous contacter directement.
Quel est votre délai de livraison ?
Le délai de livraison dépend de la quantité commandée et de la saison. En règle générale, nous pouvons expédier dans les 7 15 jours pour les petites commandes et dans environ 30 jours pour les commandes en gros.
Quelles sont vos conditions de paiement ?
Prix d'usine avec un acompte de 30 %, le solde de 70 % devant être viré avant l'expédition.
Quelles sont les méthodes d'expédition disponibles ?
Les options disponibles incluent le fret maritime, le fret aérien ou la livraison express (EMS, UPS, DHL, TNT, FEDEX). Veuillez confirmer avec nous avant de commander.
Circuit intégré logique programmable 48PLLs FPGA 0.95V GW2A-LV18MG196C8/I7
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