XC3S1400A-4FGG484I programmant les cellules 1.26V de logique d'IC Chip Embedded FPGAs
Number modèle:XC3S1400A-4FGG484I
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Détails du produit
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Détails du produit
XC3S1400A-4FGG484I IC programmable
Le paquet de la puce 484-BBGA a inclus des cellules de logique de
circuits intégrés de FPGAs
Nombre de laboratoires/CLBs | 2816 | |
Nombre d'éléments logiques/de cellules | 25344 | |
RAM Bits total | 589824 | |
Nombre d'entrée-sortie | 375 | |
Nombre de portes | 1400000 | |
Tension - approvisionnement | 1.14V | 1.26V | |
Montage du type | ||
Température de fonctionnement | -40°C | 100°C (TJ) | |
Paquet/cas | ||
Paquet de dispositif de fournisseur | 484-FBGA (23x23) | |
Nombre bas de produit |
XC3S1400A-4FGG484I comporte
• Coût bas même, solution performante de logique pour
applications fort débit et conscientes des coûts
• l'approvisionnement de la Double-gamme VCCAUX simplifie la
conception 3.3V-only
• Suspendez, hibernez les modes pour réduire la puissance de
système
• Multi-tension, goupilles multistandard d'interface de SelectIO™
• Jusqu' 502 bornes d'entrée-sortie ou 227 paires de signal
différentiel
• LVCMOS, LVTTL, HSTL, et entrée-sortie assymétrique de SSTL
• signalisation 3.3V, 2.5V, 1.8V, 1.5V, et 1.2V
• Commande sélectionnable de sortie, jusqu' 24 mA par goupille
• La norme de QUIETIO réduit le bruit de changement d'entrée-sortie
• Pleine 3.3V compatibilité du ± 10% et conformité chaude d'échange
• Taux de transfert des données de 640+ Mb/s par entrée-sortie
différentielle
• LVDS, RSDS, mini-LVDS, entrée-sortie différentielle de HSTL/SSTL
avec les résistances différentielles intégrées d'arrêt
• Double appui augmenté du débit (RDA)
• Appui de DDR/DDR2 SDRAM jusqu' 400 Mb/s
• 32-/64-bit entièrement conforme, 33/66 mégahertz d'assistance
technologique de PCI®
• Ressources abondantes et flexibles de logique
• Les densités jusqu' 25 344 cellules de logique, y compris le
registre décalage facultatif ou ont distribué l'appui de RAM
• Multiplexeurs larges efficaces, logique large
• La lecture anticipée rapide portent la logique
• 18 x 18 multiplicateurs augmentés avec la canalisation
facultative
• Programmation d'IEEE 1149.1/1532 JTAG/corriger le port
• Architecture hiérarchique de mémoire de SelectRAM™
• Jusqu' 576 Kbits du bloc rapide RAM avec l'octet écrivent permet
pour des applications de processeur
• Jusqu' 176 Kbits de RAM distribué efficace
• Jusqu' huit directeurs de pendule lecture digitale (DCMs)
• Élimination oblique d'horloge (boucle verrouillée de retard)
• Synthèse de fréquence, multiplication, division
• Déphaseur haute résolution
• Grande plage de fréquence (5 mégahertz plus de 320 mégahertz)
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