Le paquet programmable de la puce 676-FCBGA de XC5VLX30-1FFG676C IC a inclus des applications générales de haute performance de FPGAs

Number modèle:XC5VLX30-1FFG676C

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Détails du produit

XC5VLX30-1FFG676C IC programmable

Le paquet de la puce 676-FCBGA a inclus des applications générales de haute performance de FPGAs

Nombre de laboratoires/CLBs	2400
Nombre d'éléments logiques/de cellules	30720
RAM Bits total	1179648
Nombre d'entrée-sortie	400
Tension - approvisionnement	0.95V \| 1.05V
Montage du type	Bti extérieur
Température de fonctionnement	0°C \| 85°C (TJ)
Paquet/cas	676-BBGA, FCBGA
Paquet de dispositif de fournisseur	676-FCBGA (27x27)
Nombre bas de produit	XC5VLX30

Résumé des caractéristiques de Virtex-5 FPGA

• Cinq plates-formes LX, LXT, SXT, TXT, et FXT
− Virtex-5 LX : Applications générales performantes de logique
− Virtex-5 LXT : Logique performante avec la connectivité périodique avancée
− Virtex-5 SXT : Applications performantes de traitement des signaux avec la connectivité périodique avancée
− Virtex-5 TXT : Systèmes performants avec la connectivité périodique avancée double densité
− Virtex-5 FXT : Systèmes inclus performants avec la connectivité périodique avancée

• compatibilité de Croix-plate-forme
Le − LXT, les dispositifs de SXT, et de FXT sont empreinte de pas compatible dans le même paquet utilisant les régulateurs de tension réglables

• La plupart d'avancé, performant, optimal-utilisation, tissu de FPGA
Vraie technologie de la table de consultation de 6 entrées de − (LUT)
Double option 5-LUT de −
Cheminement de réduire-houblon amélioré par −
option distribuée 64-bit de RAM de −
Option du − SRL32/Dual SRL16

• Synchronisation puissante de la tuile de gestion d'horloge (CMT)
Blocs du directeur de pendule lecture digitale de − (DCM) pour l'amortissement de retard, la synthèse de fréquence, et l'horloge zéro déphaseuse
Les blocs du − PLL pour l'entrée se trémoussent filtrage, amortissement nul de retard, synthèse de fréquence, et division phase-assortie d'horloge

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