Puce informatique 256Mbit 167MHz 135mA 7.5ns d'IC de mémoire de drachme de MT48LC16M16A2P-6A G

Number modèle:SERVICE INFORMATIQUE DE MT48LC16M16A2P-6A : G
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SERVICE INFORMATIQUE DE MT48LC16M16A2P-6A : Puces de mémoire de drachme de G 256 Mbit 167MHz 135mA 7.5ns TSOP-54

Caractéristiques

Attribut de produitValeur d'attribut
bit 16
16 M X 16
Code de FBGA D9NNF
167 mégahertz
7,5 NS
3,6 V
3 V
135 mA
- 40 C
+ 85 C

Description

 

Généralement les dispositifs de 256Mb SDRAM (16 mégohms des banques de x 4 x 4, 8 mégohms des banques de x 8 x 4, et 4 mégohms des banques de x 16 x 4) sont DRACHME de quadruple-banque qui fonctionnent 3.3V et incluent une interface synchrone. Tous les signaux sont enregistrés sur le bord positif du signal d'horloge, CLK. Chacune des banques mordues de x4 67 108 864 est organisée en tant que 8192 colonnes de rangées d'ici 2048 par 4 bits. Chacune des banques mordues de x8 67 108 864 est organisée en tant que 8192 colonnes de rangées d'ici 1024 par 8 bits. Chacune des banques mordues de x16 67 108 864 est organisée en tant que 8192 rangées par 512 colonnes par 16 bits.

La lecture et des accès en écriture SDRAM sont orientée éclat ; les accès commencent un emplacement choisi et continuent pour un nombre programmé d'emplacements dans un ordre programmé. Les accès commencent par l'enregistrement d'une commande ACTIVE, suivi d'une LECTURE ou la touche d'écriture. Le peu d'adresse a enregistré coïncident avec la commande ACTIVE est employé pour choisir la banque et rangée accéder (BA0 et BA1 choisissent la banque, [12:0] choisissent la rangée). Le peu d'adresse (x4 : [9:0], A11 ; x8 : [9:0] ; x16 : [8:0]) a enregistré coïncident avec la LECTURE ou la touche d'écriture sont employés pour choisir l'emplacement commençant de colonne pour l'accès d'éclat.

Avant le fonctionnement normal, SDRAM doit être initialisé. Les sections suivantes fournissent l'initialisation de dispositif de bche des informations détaillées, la définition de registre, les descriptions de commande, et l'opération de dispositif.

Tableau d'adresse

Caractéristiques

• PC100- et PC133-compliant

• Entièrement synchrone ; tous les signaux se sont enregistrés sur le bord positif de l'horloge système

• Opération interne et canalisée ; l'adresse de colonne peut être changée chaque rhythme

• Banques internes pour l'accès/pré-charge de dissimulation de rangée

• Longueurs éclatées programmables : 1, 2, 4, 8, ou feuillet plein

• La pré-charge automatique, inclut la pré-charge automatique concourante et l'automobile régénèrent des modes

• L'individu régénèrent le mode (non disponible dessus aux dispositifs)

• L'automobile régénèrent

– 64ms, cycle 8192 régénérer (commercial et industriel)

– 16ms, le cycle 8192 régénèrent (des véhicules moteur)

• entrées et sorties LVTTL-compatibles

• Alimentation d'énergie simple de 3.3V ±0.3V

Guides marchands

                                                               
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DHL exprès, 3-7 Business Day.
Commerce électronique de DHL, 12-22 Business Day.
Priorité internationale de Fedex, 3-7 Business Day
SME, 10-15 Business Day.
La poste aérienne recommandée, 15-30 Business Day.

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Renvoi

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Puce informatique 256Mbit 167MHz 135mA 7.5ns d'IC de mémoire de drachme de MT48LC16M16A2P-6A G

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