Le système de détection de l'émission de CO2 doit être équipé d'un système de détection de la pollution atmosphérique (SPD) et d'un système de détection de la pollution atmosphérique (SPD).

Ép1c6q240c8 Ic programmeur de puces Ep1c6q240c8n Fpga champ Porte programmable Array Fpga Cyclone I 598 laboratoires 185 Ios

Définition:

La famille Cyclone® est basée sur un processus SRAM en cuivre 1,5 V, 0,13 μm, couches complètes, avec des densités allant jusqu' 20 060 éléments logiques (LE) et jusqu' 288 Kbits de RAM.Avec des fonctionnalités telles que des boucles verrouillage de phase (PLL) pour l'horlogerie et une interface dédiée double débit de données (DDR) pour répondre aux exigences de mémoire DDR SDRAM et fast cycle RAM (FCRAM), les cyclones sont une solution rentable pour les applications de parcours de données. Les cyclones prennent en charge diverses normes d'E/S, y compris le LVDS des débits de données allant jusqu' 640 mégabits par seconde (Mbps),et 66 et 33 MHz, interconnexion de composants périphériques de 64 et 32 bits (PCI), pour l'interface et la prise en charge des appareils ASSP et ASIC.Altera propose également de nouveaux appareils de configuration en série faible coût pour configurer les appareils Cyclone

Caractéristiques:

La famille de dispositifs Cyclone offre les caractéristiques suivantes:

■ de 2 910 20 060 LE, voir tableau 1­1

■ Jusqu' 294 912 bits de RAM (36 864 octets)

■ Prend en charge la configuration par un dispositif de configuration en série peu coûteux

■ Prise en charge des normes d'E/S LVTTL, LVCMOS, SSTL-2 et SSTL-3

■ Prise en charge des normes PCI 66 et 33 MHz, 64 et 32 bits

■ Support pour l'entrée/sortie LVDS haute vitesse (640 Mbps)

■ Prise en charge de l'E/S LVDS basse vitesse (311 Mbps)

■ prise en charge de l'entrée/sortie RSDS de 311 Mbps

■ Jusqu' deux PLL par appareil permettent la multiplication de l'horloge et le changement de phase

■ Jusqu' huit lignes d'horloge globales avec six ressources d'horloge disponibles par rangée de blocs de matrice logique (LAB)

■ prise en charge de la mémoire externe, y compris la mémoire DDR SDRAM (133 MHz), la mémoire FCRAM et la mémoire SDRAM débit de données unique (SDR)

■ Prise en charge de plusieurs curs de propriété intellectuelle (PI), y compris les mégafonctions Altera® MegaCore® et Altera Megafunctions Partners Program (AMPPSM).

Fiche de date:

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