Réseau prédiffusé programmable de champ d'EP3SE80F780C3N 500kbit

Number modèle:EP3SE80F780C3N
Quantité d'ordre minimum:1 PCS
Conditions de paiement:T/T, Western Union, Paypal, assurance commerciale, carte de crédit
Capacité d'approvisionnement:136pcs
Délai de livraison:3-5 jour
Détails de empaquetage:Emballage de norme internationale
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Adresse: R1811, bâtiment de B, tour de Jiahe, No.3006 Shennan mi Rd, Shenzhen, Chine
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Réseau prédiffusé programmable de champ d'EP3SE80F780C3N Stratix III augmenté

 

Attribut de produitValeur d'attribut
Intel
FPGA - Réseau prédiffusé programmable de champ
Stratix III augmenté
80000
3200
Entrée-sortie 488
1,2 V 3,3 V
0 C
+ 70 C
SMD/SMT
FBGA-780
Plateau
Série :Stratix III
Marque :Intel/Altera
Bloc inclus RAM - EBR :kbit 500
Humidité sensible :Oui
Type de produit :FPGA - Réseau prédiffusé programmable de champ
Quantité de paquet d'usine :36
Sous-catégorie :Logique programmable IC
Mémoire totale :kbit 6683
Nom commercial :Stratix
Partie # noms d'emprunt :971852

Les dispositifs de Stratix III offrent les caractéristiques suivantes :
Soutien des megafunctions multiples de propriété intellectuelle des fonctions d'Altera® MegaCore® et du programme d'associés d'Altera Megafunction (AMPPSM)
■Soutien des normes de canal ultra-rapides de mise en réseau et de communications comprenant SPI-4.2, SFI-4, SGMII, Utopie IV, 10 Gigabit Ethernet XSBI, entrée-sortie rapide, et NPSI
■La seule haute densité, le FPGA performant avec le soutien 256 du bit AES volatil et la clé non-volatile de sécurité pour protéger des conceptions
■Les blocs ultra-rapides de DSP fournissent l'exécution consacrée de 9×9, 12×12, 18×18, et les multiplicateurs 36×36 ( jusqu' 550 mégahertz), multiplier-accumulent des fonctions, et des filtres finis de réponse d'impulsion (SAPIN)
■Entrée-sortie : LA terre : Rapport de PWR de 8:1 : 1 avec la sur-matrice et le sur-paquet découplant pour l'intégrité du signal robuste
■Technologie programmable de puissance, qui réduit au minimum la puissance tout en maximisant la représentation de dispositif
■Jusqu' 12 boucles verrouillage déphasé (PLLs) par dispositif qui soutiennent la reconfiguration de PLL, le changement d'horloge, la largeur de bande programmable, la synthèse d'horloge, et déphaseur dynamique
■Appui d'interface de mémoire avec la logique consacrée de DQS sur toutes les banques d'entrée-sortie
■Soutien des interfaces externes ultra-rapides de mémoire comprenant la RDA, le DDR2, le DDR3 SDRAM, le RLDRAM II, le QDR II, et le QDR II+ SRAM sur jusqu' 24 banques modulaires d'entrée-sortie
 



 

 

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