Puce des laboratoires ALTERA FPGA de l'entrée-sortie 21248 d'EP4SGX530KH40C4N 744
Number modèle:EP4SGX530KH40C4N
Quantité d'ordre minimum:1 PCS
Conditions de paiement:T/T, Western Union, Paypal, assurance commerciale, carte de crédit
Capacité d'approvisionnement:120 PCs
Délai de livraison:3-5 jour
Détails de empaquetage:Emballage de norme internationale
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Shenzhen Guangdong China
Adresse:
R1811, bâtiment de B, tour de Jiahe, No.3006 Shennan mi Rd, Shenzhen, Chine
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Détails du produit
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Détails du produit
Entrée-sortie Stratix IV GX de la puce BGA-1517 744 d'EP4SGX530KH40C4N ALTERA FPGA
| Attribut de produit | Valeur d'attribut |
|---|---|
| Intel | |
| FPGA - Réseau prédiffusé programmable de champ | |
| Stratix IV GX | |
| 531200 | |
| 21248 | |
| Entrée-sortie 744 | |
| 900 système mv | |
| 0 C | |
| + 70 C | |
| SMD/SMT | |
| BGA-1517 | |
| Plateau | |
| Débit : | 600 Mb/s 8,5 Gb/s |
| Série : | Stratix IV GX |
| Marque : | Intel/Altera |
| Fréquence maximum d'opération : | 600 mégahertz |
| Humidité sensible : | Oui |
| Nombre d'émetteurs-récepteurs : | Émetteur-récepteur 36 |
| Type de produit : | FPGA - Réseau prédiffusé programmable de champ |
| Quantité de paquet d'usine : | 12 |
| Sous-catégorie : | Logique programmable IC |
| Mémoire totale : | kbit 27376 |
| Nom commercial : | Stratix |
| Partie # noms d'emprunt : | 974500 |
La famille de dispositif de Stratix IV contient trois variantes
optimisées pour répondre différentes exigences d'application :
■Jusqu' 48 émetteurs-récepteurs CDR basés sur duplex dans Stratix IV
GX et dispositifs du GT soutenant des débits jusqu' 8,5 GBP et 11,3
GBP, respectivement
■Circuits consacrés pour soutenir la fonctionnalité de couche physique pour des protocoles périodiques populaires, tels que PCI Express (PCIe) (TUYAU) Gen1 et Gen2, Ethernet de GBP (GbE),
RapidIO, SONET/SDH, XAUI/HiGig, (OIF) CEI-6G périodiques, SD/HD/3G-SDI, Manche de fibre, SFI-5, et Interlaken
■Solution complète de protocole de PCIe avec les blocs durs inclus d'IP de PCIe qui fonctionnalité mettent en application la couche de PHY-MAC, la couche liaison de données, et de transaction couche
■Pré-accent programmable d'émetteur et circuits d'égalisation de récepteur pour compenser des pertes liées la fréquence dans le milieu physique
■Puissance moyenne physique typique de l'attachement (PMA) de 100 mW 3,125 GBP et de 135 mW 6,375 GBP par canal
■72 600 813 050 LEs équivalent par dispositif
■Kb 7 370 33 294 de la mémoire augmentée de TriMatrix se composant de trois longueurs de bloc de RAM pour mettre en application la véritable mémoire double accès et des tampons de fifo
■Blocs ultra-rapides de traitement numérique du signal (DSP) configurables en tant que 9 x 9 bit, 12 x 12 bit, bit 18 x 18, et 36 x 36 multiplicateurs mordus de plein-précision jusqu' 600 mégahertz
■Circuits consacrés pour soutenir la fonctionnalité de couche physique pour des protocoles périodiques populaires, tels que PCI Express (PCIe) (TUYAU) Gen1 et Gen2, Ethernet de GBP (GbE),
RapidIO, SONET/SDH, XAUI/HiGig, (OIF) CEI-6G périodiques, SD/HD/3G-SDI, Manche de fibre, SFI-5, et Interlaken
■Solution complète de protocole de PCIe avec les blocs durs inclus d'IP de PCIe qui fonctionnalité mettent en application la couche de PHY-MAC, la couche liaison de données, et de transaction couche
■Pré-accent programmable d'émetteur et circuits d'égalisation de récepteur pour compenser des pertes liées la fréquence dans le milieu physique
■Puissance moyenne physique typique de l'attachement (PMA) de 100 mW 3,125 GBP et de 135 mW 6,375 GBP par canal
■72 600 813 050 LEs équivalent par dispositif
■Kb 7 370 33 294 de la mémoire augmentée de TriMatrix se composant de trois longueurs de bloc de RAM pour mettre en application la véritable mémoire double accès et des tampons de fifo
■Blocs ultra-rapides de traitement numérique du signal (DSP) configurables en tant que 9 x 9 bit, 12 x 12 bit, bit 18 x 18, et 36 x 36 multiplicateurs mordus de plein-précision jusqu' 600 mégahertz
Puce des laboratoires ALTERA FPGA de l'entrée-sortie 21248 d'EP4SGX530KH40C4N 744
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