Réseau prédiffusé programmable de champ de XC5VLX155T-2FFG1136I IC FPGA FBGA-1136
Number modèle:XC5VLX155T-2FFG1136I
Quantité d'ordre minimum:1 PCS
Conditions de paiement:T/T, Western Union, Paypal, assurance commerciale, carte de crédit
Capacité d'approvisionnement:102 PCs
Délai de livraison:3-5 jour
Détails de empaquetage:Emballage de norme internationale
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Shenzhen Guangdong China
Adresse:
R1811, bâtiment de B, tour de Jiahe, No.3006 Shennan mi Rd, Shenzhen, Chine
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Réseau prédiffusé programmable de champ de XC5VLX155T-2FFG1136I IC FPGA FBGA-1136
| Attribut de produit | Valeur d'attribut |
|---|---|
| Xilinx | |
| FPGA - Réseau prédiffusé programmable de champ | |
| Virtex-5 | |
| Entrée-sortie 640 | |
| 1 V | |
| - 40 C | |
| + 100 C | |
| SMD/SMT | |
| FBGA-1136 | |
| Débit : | 6,5 Gb/s |
| Série : | XC5VLX155T |
| Marque : | Xilinx |
| RAM distribué : | kbit 1640 |
| Bloc inclus RAM - EBR : | kbit 7632 |
| Fréquence maximum d'opération : | 550 mégahertz |
| Humidité sensible : | Oui |
| Nombre d'émetteurs-récepteurs : | Émetteur-récepteur 16 |
| Type de produit : | FPGA - Réseau prédiffusé programmable de champ |
| Quantité de paquet d'usine : | 1 |
| Sous-catégorie : | Logique programmable IC |
| Nom commercial : | Virtex |
Résumé des caractéristiques de Virtex-5 FPGA
• Options de configuration flexible
− SPI et interface INSTANTANÉE parallèle
appui de Multi-bitstream de − avec la logique consacrée de reconfiguration de chute
Capacité automatique de détection de largeur d'autobus de −
• Capacité de contrôle du système sur tous les dispositifs
Sur-puce de −/surveillance thermique hors puce
Sur-puce de −/surveillance hors puce d'alimentation d'énergie
Accès du − JTAG toutes les quantités surveillées
• Blocs intégrés de point final pour des conceptions de PCI Express
Plates-formes du − LXT, du SXT, du TXT, et du FXT
− conforme avec les spécifications basses 1,1 de PCI Express
appui de la ruelle x1, x4, ou x8 de − par bloc
Travaux de − en même temps que des émetteurs-récepteurs de RocketIO™
• impers d'Ethernet du Tri mode 10/100/1000 Mb/s
Plates-formes du − LXT, du SXT, du TXT, et du FXT
Des émetteurs-récepteurs de RocketIO de − peuvent être employés comme PHY ou se relient PHY externe utilisant beaucoup d'options MII douces (d'interface indépendante de médias)
• Émetteurs-récepteurs de RocketIO GTP 100 Mb/s 3,75 Gb/s
− LXT et plates-formes de SXT
• Émetteurs-récepteurs de RocketIO GTX 150 Mb/s 6,5 Gb/s
− TXT et plates-formes de FXT
• PowerPC 440 microprocesseurs
Plate-forme du − FXT seulement
Architecture du − RISC
canalisation d'étape du − 7
les cachettes d'instruction et de données du − 32-Kbyte ont inclus
Structure d'interface de processeur optimisée par − (barre transversale)
• technologie transformatrice de l'en cuivre CMOS de 65 nanomètre
• tension du noyau 1.0V
• Haut emballage de secousse-puce d'intégrité du signal disponible dans des options standard ou sans Pb de paquet
− SPI et interface INSTANTANÉE parallèle
appui de Multi-bitstream de − avec la logique consacrée de reconfiguration de chute
Capacité automatique de détection de largeur d'autobus de −
• Capacité de contrôle du système sur tous les dispositifs
Sur-puce de −/surveillance thermique hors puce
Sur-puce de −/surveillance hors puce d'alimentation d'énergie
Accès du − JTAG toutes les quantités surveillées
• Blocs intégrés de point final pour des conceptions de PCI Express
Plates-formes du − LXT, du SXT, du TXT, et du FXT
− conforme avec les spécifications basses 1,1 de PCI Express
appui de la ruelle x1, x4, ou x8 de − par bloc
Travaux de − en même temps que des émetteurs-récepteurs de RocketIO™
• impers d'Ethernet du Tri mode 10/100/1000 Mb/s
Plates-formes du − LXT, du SXT, du TXT, et du FXT
Des émetteurs-récepteurs de RocketIO de − peuvent être employés comme PHY ou se relient PHY externe utilisant beaucoup d'options MII douces (d'interface indépendante de médias)
• Émetteurs-récepteurs de RocketIO GTP 100 Mb/s 3,75 Gb/s
− LXT et plates-formes de SXT
• Émetteurs-récepteurs de RocketIO GTX 150 Mb/s 6,5 Gb/s
− TXT et plates-formes de FXT
• PowerPC 440 microprocesseurs
Plate-forme du − FXT seulement
Architecture du − RISC
canalisation d'étape du − 7
les cachettes d'instruction et de données du − 32-Kbyte ont inclus
Structure d'interface de processeur optimisée par − (barre transversale)
• technologie transformatrice de l'en cuivre CMOS de 65 nanomètre
• tension du noyau 1.0V
• Haut emballage de secousse-puce d'intégrité du signal disponible dans des options standard ou sans Pb de paquet
Réseau prédiffusé programmable de champ de XC5VLX155T-2FFG1136I IC FPGA FBGA-1136
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