Entrée-sortie IC FPGA de XC5VFX100T-2FFG1738C 8208kbit 680
Number modèle:XC5VFX100T-2FFG1738C
Quantité d'ordre minimum:1 PCS
Conditions de paiement:T/T, Western Union, Paypal, assurance commerciale, carte de crédit
Capacité d'approvisionnement:332 PCs
Délai de livraison:3-5 jour
Détails de empaquetage:Emballage de norme internationale
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Shenzhen Guangdong China
Adresse:
R1811, bâtiment de B, tour de Jiahe, No.3006 Shennan mi Rd, Shenzhen, Chine
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dans 27 heures
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Entrée-sortie Virtex-5 de XC5VFX100T-2FFG1738C IC FPGA FCBGA-1738 680
| Attribut de produit | Valeur d'attribut |
|---|---|
| Xilinx | |
| FPGA - Réseau prédiffusé programmable de champ | |
| Virtex-5 | |
| Entrée-sortie 680 | |
| 1 V | |
| 0 C | |
| + 85 C | |
| SMD/SMT | |
| FCBGA-1738 | |
| Débit : | 6,5 Gb/s |
| Série : | XC5VFX100T |
| Marque : | Xilinx |
| RAM distribué : | kbit 1240 |
| Bloc inclus RAM - EBR : | kbit 8208 |
| Fréquence maximum d'opération : | 550 mégahertz |
| Humidité sensible : | Oui |
| Nombre d'émetteurs-récepteurs : | Émetteur-récepteur 16 |
| Type de produit : | FPGA - Réseau prédiffusé programmable de champ |
| Quantité de paquet d'usine : | 1 |
| Sous-catégorie : | Logique programmable IC |
| Nom commercial : | Virtex |
Logique de Virtex-5 FPGA
• En moyenne, un l'amélioration deux vitesses de catégorie
au-dessus des dispositifs Virtex-4
• Registres décalage variables 32 bits Cascadable ou capacité distribuée 64-bit de mémoire
• L'architecture de acheminement supérieure avec le cheminement diagonal augmenté soutient la connectivité de bloc--bloc avec les houblon minimaux
• Jusqu' 330 000 cellules de logique comprenant :
Le − jusqu' 207 360 bascules internes de tissu avec l'horloge permettent (XC5VLX330)
− jusqu' 207 360 vraies 6 tables de consultation d'entrée (LUTs) avec plus considérablement que 13 millions de bits totaux de LUT
Les sorties du − deux pour le double mode 5-LUT donne l'utilisation augmentée
Multiplexeurs en expansion de logique de − et registres d'entrée-sortie
• Registres décalage variables 32 bits Cascadable ou capacité distribuée 64-bit de mémoire
• L'architecture de acheminement supérieure avec le cheminement diagonal augmenté soutient la connectivité de bloc--bloc avec les houblon minimaux
• Jusqu' 330 000 cellules de logique comprenant :
Le − jusqu' 207 360 bascules internes de tissu avec l'horloge permettent (XC5VLX330)
− jusqu' 207 360 vraies 6 tables de consultation d'entrée (LUTs) avec plus considérablement que 13 millions de bits totaux de LUT
Les sorties du − deux pour le double mode 5-LUT donne l'utilisation augmentée
Multiplexeurs en expansion de logique de − et registres d'entrée-sortie
Résumé des caractéristiques de Virtex-5 FPGA
• Capacité de contrôle du système sur tous les dispositifs
Sur-puce de −/surveillance thermique hors puce
Sur-puce de −/surveillance hors puce d'alimentation d'énergie
Accès du − JTAG toutes les quantités surveillées
• Blocs intégrés de point final pour des conceptions de PCI Express
Plates-formes du − LXT, du SXT, du TXT, et du FXT
− conforme avec les spécifications basses 1,1 de PCI Express
appui de la ruelle x1, x4, ou x8 de − par bloc
Travaux de − en même temps que des émetteurs-récepteurs de RocketIO™
• Émetteurs-récepteurs de RocketIO GTP 100 Mb/s 3,75 Gb/s
− LXT et plates-formes de SXT
• Émetteurs-récepteurs de RocketIO GTX 150 Mb/s 6,5 Gb/s
− TXT et plates-formes de FXT
• technologie transformatrice de l'en cuivre CMOS de 65 nanomètre
• tension du noyau 1.0V
• Haut emballage de secousse-puce d'intégrité du signal disponible dans des options standard ou sans Pb de paquet
• Émetteurs-récepteurs de RocketIO GTX
Sur-puce de −/surveillance thermique hors puce
Sur-puce de −/surveillance hors puce d'alimentation d'énergie
Accès du − JTAG toutes les quantités surveillées
• Blocs intégrés de point final pour des conceptions de PCI Express
Plates-formes du − LXT, du SXT, du TXT, et du FXT
− conforme avec les spécifications basses 1,1 de PCI Express
appui de la ruelle x1, x4, ou x8 de − par bloc
Travaux de − en même temps que des émetteurs-récepteurs de RocketIO™
• Émetteurs-récepteurs de RocketIO GTP 100 Mb/s 3,75 Gb/s
− LXT et plates-formes de SXT
• Émetteurs-récepteurs de RocketIO GTX 150 Mb/s 6,5 Gb/s
− TXT et plates-formes de FXT
• technologie transformatrice de l'en cuivre CMOS de 65 nanomètre
• tension du noyau 1.0V
• Haut emballage de secousse-puce d'intégrité du signal disponible dans des options standard ou sans Pb de paquet
• Émetteurs-récepteurs de RocketIO GTX
Entrée-sortie IC FPGA de XC5VFX100T-2FFG1738C 8208kbit 680
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