Entrée-sortie Virtex II de XC2VP40-6FF1152I 350MHz 692 pro
Number modèle:XC2VP40-6FF1152I
Quantité d'ordre minimum:1 PCS
Conditions de paiement:T/T, Western Union, Paypal, assurance commerciale, carte de crédit
Capacité d'approvisionnement:68 PCs
Délai de livraison:3-5 jour
Détails de empaquetage:Emballage de norme internationale
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Shenzhen Guangdong China
Adresse:
R1811, bâtiment de B, tour de Jiahe, No.3006 Shennan mi Rd, Shenzhen, Chine
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Détails du produit
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Détails du produit
Entrée-sortie Virtex-II de XC2VP40-6FF1152I IC FPGA FBGA-1152 692 pro
| Attribut de produit | Valeur d'attribut |
|---|---|
| Xilinx | |
| FPGA - Réseau prédiffusé programmable de champ | |
| Virtex-II pro | |
| 43632 | |
| Entrée-sortie 692 | |
| 1,5 V | |
| - 40 C | |
| + 100 C | |
| SMD/SMT | |
| FBGA-1152 | |
| Débit : | 6,25 Gb/s |
| Série : | XC2VP40 |
| Marque : | Xilinx |
| RAM distribué : | kbit 606 |
| Bloc inclus RAM - EBR : | kbit 3456 |
| Fréquence maximum d'opération : | 350 mégahertz |
| Humidité sensible : | Oui |
| Nombre d'émetteurs-récepteurs : | Émetteur-récepteur 12 |
| Type de produit : | FPGA - Réseau prédiffusé programmable de champ |
| Quantité de paquet d'usine : | 1 |
| Sous-catégorie : | Logique programmable IC |
| Nom commercial : | Virtex |
Pro technologie de FPGA de plate-forme de Virtex-II
• Hiérarchie de mémoire de SelectRAM+
- Mi-bande jusqu' 8 de véritable RAM double accès dans 18 ressources du bloc SelectRAM+ de Kb
- Kb jusqu' 1 378 de ressources distribuées de SelectRAM+
- Interfaces performantes la mémoire externe
• Fonctions arithmétiques
- 18 blocs mordus consacrés de multiplicateur du bit x 18
- La lecture anticipée rapide portent des chaînes de logique
• Ressources flexibles de logique
- Jusqu' 88 192 inscriptions internes/verrous l'horloge permettent
- Jusqu' 88 192 tables de consultation (LUTs) ou registres décalage cascadable bits de la variable (1 16)
- Multiplexeurs et appui larges de fonction de large-entrée
- Chaîne de cascade et appui horizontaux de Somme-de-produits
- Transport interne de 3 états
• Circuits performants de gestion d'horloge
- Jusqu' douze modules du directeur de pendule lecture digitale (DCM)
· De-biais précis d'horloge
· Entrée-sortie de HyperTransport (LDT) avec les tampons actuels de conducteur
· Registres intégrés d'entrée et sortie de la RDA
- Mi-bande jusqu' 8 de véritable RAM double accès dans 18 ressources du bloc SelectRAM+ de Kb
- Kb jusqu' 1 378 de ressources distribuées de SelectRAM+
- Interfaces performantes la mémoire externe
• Fonctions arithmétiques
- 18 blocs mordus consacrés de multiplicateur du bit x 18
- La lecture anticipée rapide portent des chaînes de logique
• Ressources flexibles de logique
- Jusqu' 88 192 inscriptions internes/verrous l'horloge permettent
- Jusqu' 88 192 tables de consultation (LUTs) ou registres décalage cascadable bits de la variable (1 16)
- Multiplexeurs et appui larges de fonction de large-entrée
- Chaîne de cascade et appui horizontaux de Somme-de-produits
- Transport interne de 3 états
• Circuits performants de gestion d'horloge
- Jusqu' douze modules du directeur de pendule lecture digitale (DCM)
· De-biais précis d'horloge
· Entrée-sortie de HyperTransport (LDT) avec les tampons actuels de conducteur
· Registres intégrés d'entrée et sortie de la RDA
Aperçu de rangée
Virtex-II pro dispositifs X les pro et de Virtex-II sont des
réseaux prédiffusés utilisateur-programmables avec de divers
éléments configurables et
blocs inclus optimisés pour des conceptions de système haute
densité et performantes.
Entrée-sortie Virtex II de XC2VP40-6FF1152I 350MHz 692 pro
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