Shenzhen Sai Collie Technology Co., Ltd.

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Puce IC XC3S400A-4FGG320C programmant une large gamme de fréquences FPGA 1.14V

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Puce IC XC3S400A-4FGG320C programmant une large gamme de fréquences FPGA 1.14V

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Number modèle :XC3S400A-4FGG320C
Point d'origine :original
Quantité d'ordre minimum :1
Conditions de paiement :L/C, D/A, D/P, T/T, Western Union, MoneyGram
Capacité d'approvisionnement :999999
Délai de livraison :1 - 3 jours
Détails de empaquetage :Norme
Montage du type :Bâti extérieur
Température de fonctionnement :-40°C | 100°C (TJ)
Nombre d'entrée-sortie :251
Tension - approvisionnement :1.14V | 1.26V
Paquet/cas :320-BGA
Paquet de dispositif de fournisseur :320-FBGA (19x19)
PN :XC3S400A-4FGG320C
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XC3S400A-4FGG320C programmable
Plage de fréquence FPGA de paquet de la puce 320-FBGA d'IC grande

 

 

 

 

Nombre de laboratoires/CLBs
896
Nombre d'éléments logiques/de cellules
8064
RAM Bits total
368640
Nombre d'entrée-sortie
251
Nombre de portes
400000
Tension - approvisionnement
1.14V | 1.26V
Montage du type
Température de fonctionnement
0°C | 85°C (TJ)
Paquet/cas
Paquet de dispositif de fournisseur
320-FBGA (19x19)
Nombre bas de produit
 

 

 

XC3S400A-4FGG320C

 

• Multi-tension, goupilles multistandard d'interface de SelectIO™
• Jusqu'à 502 bornes d'entrée-sortie ou 227 paires de signal différentiel
• LVCMOS, LVTTL, HSTL, et entrée-sortie assymétrique de SSTL
• signalisation 3.3V, 2.5V, 1.8V, 1.5V, et 1.2V
• Commande sélectionnable de sortie, jusqu'à 24 mA par goupille

 


• La norme de QUIETIO réduit le bruit de changement d'entrée-sortie
• Pleine 3.3V compatibilité du ± 10% et conformité chaude d'échange
• Taux de transfert des données de 640+ Mb/s par entrée-sortie différentielle
• LVDS, RSDS, mini-LVDS, entrée-sortie différentielle de HSTL/SSTL avec les résistances différentielles intégrées d'arrêt
• Double appui augmenté du débit (RDA)
• Appui de DDR/DDR2 SDRAM jusqu'à 400 Mb/s

 


• 32-/64-bit entièrement conforme, 33/66 mégahertz d'assistance technologique de PCI®
• Ressources abondantes et flexibles de logique
• Les densités jusqu'à 25 344 cellules de logique, y compris le registre à décalage facultatif ou ont distribué l'appui de RAM
• Multiplexeurs larges efficaces, logique large
• La lecture anticipée rapide portent la logique
• 18 x 18 multiplicateurs augmentés avec la canalisation facultative

 


• Programmation d'IEEE 1149.1/1532 JTAG/corriger le port
• Architecture hiérarchique de mémoire de SelectRAM™
• Jusqu'à 576 Kbits du bloc rapide RAM avec l'octet écrivent permet pour des applications de processeur
• Jusqu'à 176 Kbits de RAM distribué efficace
• Jusqu'à huit directeurs de pendule à lecture digitale (DCMs)

 


• Élimination oblique d'horloge (boucle verrouillée de retard)
• Synthèse de fréquence, multiplication, division
• Déphaseur à haute résolution
• Grande plage de fréquence (5 mégahertz à plus de 320 mégahertz)

 

 

 

 

 

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