Shenzhen Sai Collie Technology Co., Ltd.

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Traitement numérique du signal inclus efficace de FPGAs IC de paquet programmable de la puce 668-FCBGA de XC4VLX25-10FFG668C

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Traitement numérique du signal inclus efficace de FPGAs IC de paquet programmable de la puce 668-FCBGA de XC4VLX25-10FFG668C

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Number modèle :XC4VLX25-10FFG668C
Point d'origine :Original
Quantité d'ordre minimum :1
Conditions de paiement :L/C, D/A, D/P, T/T, Western Union, MoneyGram
Capacité d'approvisionnement :999999
Délai de livraison :1 - 3 jours
Détails de empaquetage :Norme
Montage du type :Bâti extérieur
Température de fonctionnement :0°C | 85°C (TJ)
Nombre d'entrée-sortie :448
Tension - approvisionnement :1.14V | 1.26V
Paquet/cas :668-BBGA, FCBGA
Paquet de dispositif de fournisseur :668-FCBGA (27x27)
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XC4VLX25-10FFG668C IC programmable
Traitement numérique du signal inclus efficace de FPGAs de paquet de la puce 668-FCBGA

 

 

 

 

Nombre de laboratoires/CLBs
2688
Nombre d'éléments logiques/de cellules
24192
RAM Bits total
1327104
Nombre d'entrée-sortie
448
Tension - approvisionnement
1.14V | 1.26V
Montage du type
Température de fonctionnement
0°C | 85°C (TJ)
Paquet/cas
Paquet de dispositif de fournisseur
668-FCBGA (27x27)
Nombre bas de produit
 

 

  

Résumé des caractéristiques de la famille Virtex-4

 


• Trois familles — LX/SX/FX
- Virtex-4 LX : Solution performante d'applications de logique
- Virtex-4 SX : Solution performante pour des applications de traitement numérique du signal (DSP)
- Virtex-4 FX : Solution performante et complète pour des applications incluses de plate-forme


• Technologie d'horloge de Xesium™
- Blocs du directeur de pendule à lecture digitale (DCM)
- Diviseurs phase-assortis supplémentaires d'horloge (PMCD)
- Horloges globales différentielles

 


• Tranche de XtremeDSP™
- 18 x 18, le complément des two, ont signé le multiplicateur
- Étapes facultatives de canalisation
- Accumulateur intégré (48-bit) et additionneur/subtracteur

 


• Smart RAM Memory Hierarchy
- RAM distribué
- Blocs à double accès de 18-Kbit RAM
· Étapes facultatives de canalisation
· La logique programmable facultative de fifo remaps automatiquement des signaux de RAM comme signaux de fifo
- L'interface de mémoire ultra-rapide soutient la RDA et le DDR-2 SDRAM, le QDR-II, et le RLDRAM-II.

 

 

 

 

 

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Traitement numérique du signal inclus efficace de FPGAs IC de paquet programmable de la puce 668-FCBGA de XC4VLX25-10FFG668C

 

 

 
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