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5M160ZT100C5N support programmable de l'entrée-sortie SMD SMT des laboratoires 79 de la logique IC 16

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Pays / Région:china
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5M160ZT100C5N support programmable de l'entrée-sortie SMD SMT des laboratoires 79 de la logique IC 16

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Number modèle :5M160ZT100C5N
Point d'origine :Original
Quantité d'ordre minimum :10pcs
Conditions de paiement :L/C, T/T, Western Union, Paypal
Capacité d'approvisionnement :10000pcs/months
Délai de livraison :1-3 jours ouvrables
Détails de empaquetage :Norme
Retard de propagation :7,5 NS
Mémoire totale :bit 8192
Type de mémoire :Instantané
Laboratoires :16
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5M160ZT100C5N chaud vendant 160 éléments logiques 1,8 dispositifs logiques programmables complexes d'entrée-sortie de V 79 courant de 25 uA

 
Série : 5M160Z
Montage du style : SMD/SMT
Paquet/cas : TQFP-100
Tension d'alimentation d'opération : 1,8 V
Nombre de Macrocells : 128
Nombre d'I/Os : Entrée-sortie 79
Température de fonctionnement minimum : 0 C
Température de fonctionnement maximum : + 85 C
Fréquence maximum d'opération : 152 mégahertz
Retard de propagation - maximum : 7,5 NS
Emballage : Plateau
Type de mémoire : Instantané
Humidité sensible : Oui
Nombre de blocs de rangée de logique - laboratoires : 16
Nombre d'éléments logiques : 160
Courant d'approvisionnement d'opération : 25 uA
Type de produit : CPLD - Dispositifs logiques programmables complexes
Quantité de paquet d'usine : 90
Sous-catégorie : Logique programmable IC
Tension d'alimentation - maximum : 1,89 V
Tension d'alimentation - minute : 1,71 V
Mémoire totale : bit 8192
Partie # noms d'emprunt : 969128
Poids spécifique : 0,705479 onces

 

Caractéristique
Architecture bonne marchée, de basse puissance, et non-volatile de CPLD
■Instantané-sur (0,5 Mme ou moins) le temps de configuration
■Courant de réserve en tant que bas en tant que le µA 25 et opération rapide de puissance-vers le bas/remise
■Temps rapides de retard et de horloge-à-sortie de propagation
■Oscillateur interne
■RSDS émulé a produit l'appui avec un débit jusqu'à de 200 Mbps
■LVDS émulé a produit l'appui avec un débit jusqu'à de 304 Mbps
■Quatre horloges globales avec deux horloges disponibles par bloc de rangée de logique (LABORATOIRE)
■Bloc de mémoire instantanée d'utilisateur jusqu'à 8 Kbits pour la mémoire permanente avec jusqu'à 1000 cycles lecture/écriture
■Approvisionnement 1.8-V externe simple pour le noyau de dispositif
■Interface d'entrée-sortie de MultiVolt soutenant des niveaux de la logique 3.3-V, 2.5-V, 1.8-V, 1.5-V, et 1.2-V
■architecture qui respecte les autobus comprenant le taux de groupe programmable, la force d'entraînement, l'autobus-prise, et les résistances cabreuses programmables
■Schmitt déclenche permettre les entrées tolérantes de bruit (programmables par goupille)
■I/Os sont entièrement conformes avec les spécifications de bus local de PCI de PCI-SIG®, la révision 2,2 pour l'opération 3.3-V
■Chaud-prise conforme
■Circuits intégrés de déclaration provisoire de JTAG conformes avec la norme 1149.1-1990 d'IEEE
 
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